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PCB打样 如何避免开窗后镀锡?

如何避免开窗后镀锡?
更新时间:2024-12-12 14:22
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想做一个共面波导线,画了顶层阻焊区用于开窗,在嘉立创eda中展示3D图没有问题(铜线裸露),但是加工后发现开窗的区域镀锡了了,并且镀锡不均匀、间距较小导致信号线与旁边的地短路。该如何开窗后不镀锡?
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官方工作人员(5***5G) 2024-10-16 18:09:48
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您好,线路层有图案的地方做出来就是铜面,阻焊层有图案的地方做出来不盖油,线路层与阻焊层重合的地方才会做出露铜上锡或沉金(依下单选择)效果的。FR4板暂不做光铜的,抱歉!
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